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やっぱりVerilog HDL

に乗り換えることにしました。

HDLの勉強を始める際、Verilog HDLの表現が、慣れ親しんだC言語と混同しそうなので、あえてVHDLを選択したのですが、大規模な論理回路になってくるとVerilog HDLの方が楽そう！？ということで、結局乗り換えることにしました(^_^;)

投稿者: RJB 日時: 2007年02月25日 23:33 |

コメント

こんばんはPochiです。

ずぼらな私もVerilog派です。
圧倒的に記述量少なくてすみますもんね。　V(^_^)

投稿者: Pochi | 2007年03月01日 21:05

PochiさんもやっぱりVerilogなのですね。
道のりは長いですが、ある程度理解できるようになったら「SynclonOne」をじっくり勉強させて頂こうと思っています。

投稿者: RJB | 2007年03月02日 00:01

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